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Circuits numériques : conception en VHDL pour cible FPGA

Systèmes et Objets Intelligents

Cette formation vise à comprendre et acquérir les bases de la conception VHDL pour cible FPGA.

Stage soutenu par l'IRT Nanoelec.

Elle s’appuie sur les moyens techniques développés par Grenoble INP dans le cadre de sa filière Systèmes Electroniques Intégrés notamment.

Public cible :

Ingénieurs ou techniciens souhaitant implanter des applications sur cibles FPGA. Notions de logique combinatoire et séquentielle requises

Compétences développées :

- Comprendre les étapes de conception d’architectures numériques portables pour cible FPGA
- Connaître une méthodologie de conception VHDL pour cibles FPGA
- Acquérir des compétences en conception VHDL (importance des phases de synthèse des architectures)

Catégorie :

Formation continue – électronique

Durée de formation :

4 jours

Le + : Plus de la moitié de la formation se déroule sous forme de travaux pratiques avec des études de cas sur ordinateurs équipés d'outils de CAO électronique de simulation et de synthèse. Intervenants : enseignants-chercheurs du département Image et Parole au sein du laboratoire Gipsa Lab, spécialistes reconnus dans le domaine de l’adéquation algorithme architecture.
logo fd noir

IRT NANOELEC FORMATION17 rue des Martyrs
38054 Grenoble cedex 9

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Un programme conduit par :

GEMbaselineCCI grand format blanc 300dpi      Grenoble INP Logo blanc RVB

 

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